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1、(10)申请公布号 CN 103838284 A (43)申请公布日 2014.06.04 CN 103838284 A (21)申请号 201210489090.6 (22)申请日 2012.11.26 G05F 1/56(2006.01) H03K 17/28(2006.01) (71)申请人 西安威正电子科技有限公司 地址 710077 陕西省西安市高新区锦业路 69 号 C 区 1 号瞪羚谷 B 栋 6 层 (72)发明人 杨立斌 (74)专利代理机构 西安智大知识产权代理事务 所 61215 代理人 刘国智 (54) 发明名称 一种并联 LDO 延时启动电路 (57) 摘要 一种并联。
2、 LDO 延时启动电路， 分为前级电源 和后级电源， 后级电源为多路 LDO 芯片， 每路 LDO 芯片的输入端接至前级电源的输出端， 每路 LDO 芯片的输入端与使能端之间接有电阻， 使能端通 过电容接地， 该电阻电容构成 RC 迟滞回路， 每路 LDO 芯片的 RC 回路配置不同的参数， 实现延迟启 动， 本发明通过 RC 迟滞回路来延迟使能 LDO 电路 的 EN 管脚， RC 回路配置不同的参数， 从而避免了 LDO 同时启动。 (51)Int.Cl. 权利要求书 1 页 说明书 1 页 附图 1 页 (19)中华人民共和国国家知识产权局 (12)发明专利申请 权利要求书1页 说明书1。
3、页 附图1页 (10)申请公布号 CN 103838284 A CN 103838284 A 1/1 页 2 1. 一种并联 LDO 延时启动电路， 分为前级电源和后级电源， 其特征在于， 后级电源为多 路 LDO 芯片， 每路 LDO 芯片的输入端接至前级电源的输出端， 每路 LDO 芯片的输入端与使能 端之间接有电阻， 使能端通过电容接地， 该电阻电容构成 RC 迟滞回路， 每路 LDO 芯片的 RC 回路配置不同的参数， 实现延迟启动。 2. 根据权利要求 1 所述并联 LDO 延时启动电路， 其特征在于， 后级电源为双路 LDO 芯 片。 权 利 要 求 书 CN 103838284 。
4、A 2 1/1 页 3 一种并联 LDO 延时启动电路 技术领域 0001 本发明涉及并联 LDO 启动控制技术领域， 特别涉及一种并联 LDO 延时启动电路。 背景技术 0002 对于一般的线性电源， 大多数已经使用 LDO 芯片， 外围配置简单的电路， 目前大多 数 LDO 的芯片建议的典型电路均是 EN 脚直接和 LDO 的 Vin 管脚相连， 这种方式的缺点是当 多路 LDO 并联时， LDO 会同时启动， 造成前级较大的启动冲击电路。 发明内容 0003 为了克服上述现有技术的不足， 本发明的目的在于提供一种并联 LDO 延时启动电 路， 采用延迟电路， 利用了 RC 迟滞回路， 不。
5、同的 RC 参数的延迟时间不一样， 达到避免 LDO 同 时启动的目的。 0004 为了实现上述目的， 本发明采用的技术方案是 ： 0005 一种并联 LDO 延时启动电路， 分为前级电源和后级电源， 后级电源为多路 LDO 芯 片， 每路LDO芯片的输入端接至前级电源的输出端， 每路LDO芯片的输入端与使能端之间接 有电阻， 使能端通过电容接地， 该电阻电容构成 RC 迟滞回路， 每路 LDO 芯片的 RC 回路配置 不同的参数， 实现延迟启动。 0006 与现有技术相比， 本发明通过 RC 迟滞回路来延迟使能 LDO 电路的 EN 管脚， RC 回 路配置不同的参数， 从而避免了 LDO 。
6、同时启动。 附图说明 0007 附图为本发明的结构示意图。 具体实施方式 0008 下面结合附图和实施例对本发明进行更详尽的说明。 0009 如图所示， 本发明为一种并联 LDO 延时启动电路， 分为前级电源和后级电源， 后级 电源为双路 LDO 芯片， 每路 LDO 芯片的输入端接至前级电源的输出端， 每路 LDO 芯片的输入 端与使能端之间接有电阻， 使能端通过电容接地， 该电阻电容构成 RC 迟滞回路。 0010 增加RC的迟滞回路后， R1C1的延迟参数和R2C2的延迟参数不同， 在前级Vout1启 动后， U2 和 U3 的 EN 管脚开启的时间不同， 使 Vout2 和 Vout3 的启动时间错开， 对于 Vout1 而言是减少了容性负载， 减少了启动时的冲击电流。 0011 对比原方案与本方案， 原方案中， Vout2 和 Vout3 同时启动， 相对于 Vout1 而言负 载电容是 2 倍的 C3， 输出冲击电流至少是本方案的 2 倍。 说 明 书 CN 103838284 A 3 1/1 页 4 说 明 书 附 图 CN 103838284 A 4 。