本发明是关于传真装置等中的图象信号的译码电路，更详细地说是关于含有在将已编码的图象信号接收，译码时，检出扫描线同步信号（以下称作EOL信号），以形成供译码处理的信号的电路的译码电路。 一直以来，在传真装置，电子档案等的装置中使用着微处理器，通过存储于存储器中的程序，进行图象信号的编码、译码的处理。作为这样的装置，例如有在社团法人电子通信学会的电子通信学会技术研究报告《多点监视控制用LSI（大规模集成）化处理器》，SSD20，No.52，1980年10月28日，页1～8，以及冲电器研究开发《传真用通常LSI的开发》第114号，Vol.48，No.2，1981年，页31～33所公开的例子。
根据在这种装置中所使用的程序的处理，是指基于CCITT（国际电报电话咨询委员会）建议T4的图象黑白信号的编码和译码。
在上述原来的装置中的译码，是将图象信号的EOL信号接收，而将EOL信号之后的图象信息译码，变换为图象扫描信号。这里的EOL信号是被附加于页的最初的扫描线的信息之前及扫描线的信息之后，成为12位的“000000000001”形式的信号。被接收的编码方式的确认，是通过在图象信号收信之前，预定于传真装置中的通信控制程序来进行的。在程序处理中，以受信图象信号为基础，对每一象素检出黑、白信号，通过将EOL信号EOL，图象信息读出，进行译码操作。
可是，在上述现有技术的装置中，由于是通过微处理器的程序处理来进行图象信号的编码及译码，在这处理上很费时。在连续复数页的图象的收信中，在换页的地方，接收由6个连续的EOL信号组成的控制重置信号（以下称做RTC信号），以与其他信号区别。通常，在收信方面在认识到这6个EOL信号之中的3～4个就作为一页的完结。这时，对EOL信号（12位或13位）每次进行计数，区别EOL以后的图象信息进行处理的程序逻辑变得非常复杂。
因此，本发明的目的是为了解决上述现有技术的问题点，提供避开区别EOL信号与其后的图象信息的复杂的逻辑，以简单的电路结构来实现译码的译码电路。更进一步，本发明提供比采用LSI化技术的专用逻辑电路更经济的译码电路。
本发明是关于接收已被编码的图象信号，从该图象信号检出附加于各项，各扫描线上的同步信号，把图象信息译码的译码电路。为了解决上述现有技术的问题点，本发明由具有一定段数的第1移位寄存器，具有对应于被连接于该第1移位寄存器的最下段输出，而被附加于图象信息之前的同步信号的位数的段数的第2移位寄存器，以及被接于上述第1移位寄存器的各段输出与上述第2移位寄存器的各段输出的逻辑手段而构成。第1移位寄存器例如由8位的移位寄存器构成，而第2移位寄存器例如由12位或13位的移位寄存器构成。这是基于根据规格，所接收的同步信号（EOL信号）是EOL（“000000000001”）、EOL+1（“0000000000011”）、EOL+0（“0000000000010”）以及EOL之后的8位内一定存在逻辑电平“1”的信号的这一事实而构成的。
附加于图象信息之前的同步信号及其后的图象信息被串联地顺次收纳于第1及第2寄存器中。逻辑手段根据第1寄存器及第2寄存器的各段的输出，通过检出同步信号及图象信息中的1位以上的逻辑“1”的信号，将位于图象信息之前的同步信号进行逻辑输出。因此，能在短时间内正确地捕捉同步信号，解决了上述现有技术的问题点。
图1是表示本发明的实施例的译码电路的方块图。图中，1是图象信号的输入端，11是EOL检测部，12是接收信息译码部、13是译码前处理部，14是FIFO（先进先出）存储部，15是译码后处理部，16是线存储部A，17是线存储部B。
图2是详细地表示本实施例的EOL检测部11的电路图。图3是表示将传真图象信息的2维码译码时的处理程序的表，这个表是表示根据存储程序的处理程序。图中，P是传递模式、H是水平模式：V（V（0）、VR（1）、VR（2）、VR（3）、VL（1）、VL（2）、VL（3））是垂直模式。图4是表示传真图象信号的EOL信号及图象信息的构成例，图5是详细地表示图4的一部的图。在图4及图5所举出的是2维编码的图象信息的例子，这个形式通过图象信号的接收之前，在传真装置之间所进行的通信而被确认，即通过两个传真装置之间预先进行的通信，以确认全体信号是1维编码的还是2维编码，以及如果是2维编码的情形，其接续于先头的EOL信号（EOL+1或EOL+0）之后的图象信息是1维编码信息还是2维编码信息。再者，接续于EOL之后的“1”、“0”的标记位分别表示下一行为1维编码信息及2维编码信息，进而将附加有标记位的EOL信号置于信息行。
图1的输入端子1是将被双值化了的图象信号接收，并把它供给EOL检测部11。EOL检测部从所接收的图象信号中自动地对每行检出EOL信号，接收信息译码部12具有正确地动作的机能，即保证接收信息的各信息的始位都来到在图3所示的出发点（初始设定点）。接收信息译码部12通过输入端子1及EOL检测部11而将接收信息输入，例如，当接收信息是所谓字首代码时，便与译码前处理部13连动，按照图3所示的处理表对每1位进行译码处理。于是对V（0）、H、……等的字首代码之一作译码判定。译码处理至各终点后，在各终点处，译码前处理部13作动，将译码后的信息转送到FIFO存储部14。FIFO存储部将被转送来的信息存储。当图象信号的接收及其译码时，必须将各图象信号的各行的始位、或图象信息的始位正确地捕捉，并在接收信息译码部12处理。译码后处理部15对来自FIFO存储部14的信息进行变换处理，被变换后的信息被供给到线存储部A16或线存储部B17的其中一方，即不作输出动作的一方，以供扫描。
下面，参照图2，对EOL检测部11作更详细的说明。图2中，1是输入端子，2是同步信号输入端子，4、5、6是输出端子，21是8位移位寄存器、22是13位的移位寄存器、23～28是逻辑电路。
输入端子1与图1的相同，接收图象信号。输入端子将对应于1位时间的同步信号（CK）输入。移位寄存器21、22分别有8个，采用13个的触发器（以下称做F/F）以众所周知的技术而构成，输出逻辑“1”或“0”的信号。移位寄存器22将移位寄存器21内的NO.1的F/F的输出作为输入信号。因此，移位寄存器21、22将从与同步信号脉冲输入端子输入的同步信号（CK）同步的连续接收信号存储，并对下位F/F转送每1位信号。EOL检测部11的机能是从图4所示的图象信号的各行始位T点开始，监视12或13位及8位的信号，检出所定的EOL信号，并对解码前处理部13送出所检出的信号。端子4将1维编码处理时的各行的EOL信号输出。端子5将2维编码处理时的各行的EOL信号，即接续于EOL信号之后的图象信息为1维编码信息时的（EOL+1）输出。端子6将2维编码处理时的各行的EOL信号，即接续于EOL信号的图象信息为2维编码信息时的（EOL+0）输出。
在2维编码的情形，1维编码信息在每2行或每4行或只在最初的行出现，这是CCITT的建议所规定的。图5所示的图象信号的T点的右方的13位及8位的信号，在被存储于图2所示的移位寄存器21、22时，对图2的端子5输出检测信号。图5所示的各图象信号1，0从左方起在每一同步脉冲被转送给寄存器21、22的NO.1～NO.8的F/F，及NO.1～NO.13的F/F。至于以端子4、5、6的哪一方的输出作为EOL信号则由译码前处理部13选择。
如上所示，根据本发明，由于设立了第1移位寄存器，第2移位寄存器及逻辑手段，所以能在短时间内正确地捕捉同步信号。因此，具有高速地及容易地进行译码处理的优点。在将本发明用于传真装置时，对于装置的高速工作是非常有效的，因为保证其工作的译码处理的逻辑简单，所以对提高经济效果也有帮助。
附图的简单说明
图1是本发明的实施例的译码电路的方块图，图2是上述实施例中的EOL检测部的详细电路图，图3是表示2维编码信息的处理程序的图表，图4及图5是分别表示接收图象信号的构成例及一部分详细例子的图。
11……EOL检测部，12……接收信息编码部，13……译码前处理部，14……FIFO存储部，15……译码后处理部，16……线存储部A，17……线存储部B。